Ingénieur Design Digital BackEnd H/F - TPE en croissance - Electronique et Télécoms #NoSSII

CDI — Sophia Antipolis (06)

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  • Postuler avant samedi 31 août
  • Réf. MILEJUN03
  • CDI
  • Sophia Antipolis (06)
  • 50-65 K€ annuels
  • Ajoutée
  • Electronique
  • Challenge, State of the art, Parts de société
  • Création de poste
  • Contact Mathieu

Résumé

Ingénieur Design Digital Backend en CDI pour une TPE de Sophia Antipolis dans le domaine de l'électronique et les télécoms. Solutions propriétaires uniques, gros projets en cours à l'international. Equipe R&D, polyvalence et complexité technique, 50-65k€


JobOpportunIT est un cabinet de recrutement et chasseur de têtes spécialisé en informatique. Pas de SSII/ESN/consulting, uniquement des postes en client final : startup, éditeurs de logiciels, PME et grands groupes. Conseils personnalisés, mise en avant de votre candidature, relation de confiance avec nos clients, gratuité : Pourquoi passer par nous ?

CONTEXTE

Notre client est une petite entreprise de 15 ans d'existence à Sophia Antipolis. Spécialisé dans la conception de solutions innovantes dans l'électronique et les semi-conducteurs, la commercialisation a commencé il y a quelques années seulement après beaucoup de R&D.  Ils proposent des produits télécoms programmables par l’intermédiaire d'un logiciel propriétaire. 

Ce sont les seuls au niveau mondiale à tenir tête sur leur secteur aux grosses multinationales, devant les américains. Ils sont en plein boom avec la signature de nouveaux partenariats et contrats avec de grands noms de nombreux domaines industriels. C'est une structure solide financièrement. Le plan à 5 ans prévoit de grossir de façon exponentielle avec des représentants partout dans le monde.

La société compte aujourd'hui une 15aine de personnes, dont plus de la moité dans les équipes techniques. La R&D est composée de 3 équipes : hardware (4 personnes), software (2 personnes) et RTL (2 personnes). Ils se sont installés récemment sur la Côte d'Azur. C'est dans ce contexte que sont recrutés plusieurs nouveaux collaborateurs : Ingénieur design digital back-end, Ingénieur développement logiciel C++ Senior, Ingénieur logiciel C++ Junior, Ingénieur développement logiciel C++/QT...

Pas de "chichi" chez eux, vous y trouverez une ambiance calme et sereine. Tout le monde est moteur dans l'entreprise et se doit d'être force de proposition. L'adhésion au projet et à sa construction est très forte. Un point hebdomadaire permet de se tenir au courant et de partager les informations. Pas d'événements officiels mais des initiatives personnelles.

POSTE

Encadré par le CTO de la société, vous travaillerez sur des solutions complexes en électronique et logiciel. Vous serez en charge de réaliser l'implémentation physique ASIC et de l'architecture FPGA, pour les générations actuelles et futures des produits de la société. Vous travaillerez sur la totalité du flow back-end (outils Cadence).

Chose rare, vous aurez la possibilité de toucher à de tout nouveaux semi-conducteurs de pointe (node 180 à 7nm) dans une équipe qualifée !

Vos tâches seront les suivantes :

  • Echanges et réunions internes essentiellement, peu avec les clients
  • Architecture et implémentation ASIC/FPGA, 
  • Design et synthèse RTL/VHDL 
  • Méthodologie et développement de flux automatisés pour atteindre les objectifs de performance sur AOCV
  • Gestion des erreurs d'intégration DRC/VLS et analyse sur des outils d'EDA P&R
  • Mise en place de scripts et make files (Tcl, Python et Bash)
  • Veille

Les projets très challenging sur lesquels vous travaillerez ne peuvent pas être divulgués mais une road map bien précise a été établie. Ce sont en effet de gros contrats sous-jacents avec des contraintes de confidentialité et de secret industriel important.

Environnement technique : FPGA, ASIC, STA, VHDL, AOCV, DRC/LVS, RTL/VHDL, EDA, Tcl, Python, Bash...

PROFIL 

Diplômé Bac+5/8 en informatique et/ou électronique/télécom obligatoire.

Profil expérimenté/sénior, minimum 5 ans d'expérience, dans l'implémentation de circuits physiques ASIC.

Compétences techniques attendues :

  • Maîtrise des circuits intégrés ASIC
  • Connaissances de Cadence (flow digital EDA)
  • Connaissances en intégration IP de haut niveau
  • Connaissances en technologies semiconducteurs : node 28, 16, 14nm et moins
  • Connaissances en scripting Tcl, Python et/ou Bash

Anglais fluent minimum obligatoire.

Les plus pour le poste : 

  • Connaissances en FPGA (architecture, logiciel)
  • Connaissances en développement C/C++
  • Connaissances en design RTL (VHDL, Verilog et/ou SystemVerilog)

Qualités attendues : organisé, sérieux, pointilleux et force de proposition.

CONDITIONS SALARIALES

Contrat CDI Cadre.

Fourchette de salaire volontairement large selon le profil et l'expérience, ce sera au cas par cas : 50-65k€

Avantages  : Mutuelle 100% gratuite, parts de la société gratuites après la période d'essai et primes prévues dans un avenir proche.

PROCESS DE RECRUTEMENT  

Suite à un point complet et à l’envoi, avec votre accord, de votre CV à notre client, vous avancez et négociez directement avec lui.

Les étapes sont les suivantes :

  • Echange téléphonique de 30 min.
  • Entretien physique de 3-4h (pouvant être décomposé en 2) : RH/motivation avec la direction et technique avec les équipes R&D.
  • Propal

Photos

Ci-dessous, 1 photo des locaux de l'entreprise.

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